كلما زادت طلبات التقديم التي ترسلينها، زادت فرصك في الحصول على وظيفة!

إليك لمحة عن معدل نشاط الباحثات عن عمل خلال الشهر الماضي:

عدد الفرص التي تم تصفحها

عدد الطلبات التي تم تقديمها

استمري في التصفح والتقديم لزيادة فرصك في الحصول على وظيفة!

هل تبحثين عن جهات توظيف لها سجل مثبت في دعم وتمكين النساء؟

اضغطي هنا لاكتشاف الفرص المتاحة الآن!
نُقدّر رأيكِ

ندعوكِ للمشاركة في استطلاع مصمّم لمساعدة الباحثين على فهم أفضل الطرق لربط الباحثات عن عمل بالوظائف التي يبحثن عنها.

هل ترغبين في المشاركة؟

في حال تم اختياركِ، سنتواصل معكِ عبر البريد الإلكتروني لتزويدكِ بالتفاصيل والتعليمات الخاصة بالمشاركة.

ستحصلين على مبلغ 7 دولارات مقابل إجابتك على الاستطلاع.


تم إلغاء حظر المستخدم بنجاح
https://bayt.page.link/QAStRr3VZ4GAqfPr9
العودة إلى نتائج البحث‎

Senior Engineer - SOC Verification

قبل 30+ يومًا 2026/08/16
خدمات الدعم التجاري الأخرى
أنشئ تنبيهًا وظيفيًا لوظائف مشابهة
تم إيقاف هذا التنبيه الوظيفي. لن تصلك إشعارات لهذا البحث بعد الآن.

الوصف الوظيفي

Position Overview:


We are looking for a highly experienced Senior Engineer in SoC Design Verification to join our dynamic team and contribute to the development of cutting-edge SoC solutions. 


As a Senior Engineer in SoC Design Verification, you will play a key role in leading the SV/UVM based Subsystem and SoC verification strategy, planning, and execution for complex SoC projects. You will collaborate closely with cross-functional teams to ensure the highest quality and performance standards for our SoC products. This role requires deep technical expertise, leadership skills, and a passion for solving challenging verification problems.


Key Responsibilities:


  • Architect and develop reusable testbenches and Verification IP (VIP) using SystemVerilog and UVM to create scalable verification environments from scratch.
  • Drive coverage closure, ensuring thorough functional coverage and code coverage across all SoC components.
  • Implement and manage SV assertions and coverage-driven verification strategies to validate designs effectively.
  • Utilize formal verification methods and tools to verify complex blocks and subsystems, complementing simulation-based verification.
  • Develop comprehensive test plans and ensure their execution at the block, subsystem, and full-chip levels.
  • Lead debug activities and identify design and verification bottlenecks early in the development cycle.
  • Mentor junior engineers on best practices for SV/UVM, reusable verification, assertions, and coverage analysis.
  • Collaborate with design, architecture, and system-level teams to define and implement verification strategies that meet stringent quality and performance goals.
  • Drive continuous improvement of verification methodologies and tools to enhance team efficiency and quality.

Requirements:


  • 3+ years of experience in ASIC/SoC verification, specializing in SystemVerilog (SV) and Universal Verification Methodology (UVM).
  • Proven expertise in building reusable verification environments and VIP development from the ground up.
  • Strong experience with coverage-driven verification, including functional and code coverage analysis and closure.
  • Expertise in writing and debugging SV assertions and applying formal verification techniques.
  • Hands-on experience with the full verification lifecycle, from test plan creation to regression analysis and closure.
  • Strong problem-solving, debugging, and analytical skills in a fast-paced environment.
  • Bachelor’s or Master’s degree in Electronics, Electrical Engineering, Computer Engineering, or related field.

Nice to Have:


  • Experience with Pre-Silicon Validation, including test environment setup and validation strategies.
  • Proficiency in FPGA prototyping and hardware emulation to complement verification strategies.
  • Familiarity with ARM-based SoC architectures and high-performance SoC designs for applications such as IP Cameras, automotive, or AI/ML.
  • Knowledge of low-power verification and formal verification techniques.

Why Join Us?:


  • Be part of a team pushing the boundaries of ASIC SoC design.
  • Work on cutting-edge technology in a collaborative and innovative environment.
  • Competitive salary and benefits.
  • Opportunities for growth and leadership within the company.
لقد تمت ترجمة هذا الإعلان الوظيفي بواسطة الذكاء الاصطناعي وقد يحتوي على بعض الاختلافات أو الأخطاء البسيطة.
لقد تجاوزت الحد الأقصى المسموح به للتنبيهات الوظيفية (15). يرجى حذف أحد التنبيهات الحالية لإضافة تنبيه جديد.
تم إنشاء تنبيه وظيفي لهذا البحث. ستصلك إشعارات فور الإعلان عن وظائف جديدة مطابقة.
هل أنت متأكد أنك تريد سحب طلب التقديم إلى هذه الوظيفة؟

لن يتم النظر في طلبك لهذة الوظيفة، وسيتم إزالته من البريد الوارد الخاص بصاحب العمل.